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  5. Curso de Bacharelado em Engenharia Elétrica - CEEI - Relatórios de Estágio
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dc.creator.IDLEITE, T. F. P.pt_BR
dc.creator.Latteshttp://lattes.cnpq.br/4836851329007004pt_BR
dc.contributor.advisor1FREIRE, Raimundo Carlos Silvério.
dc.contributor.advisor1IDFREIRE, R. C. S.pt_BR
dc.contributor.advisor1Latteshttp://lattes.cnpq.br/4016576596215504pt_BR
dc.contributor.referee1SERRES, Alexandre Jean René.
dc.contributor.referee1IDSERRES, A. J. R.pt_BR
dc.description.resumoA redução contínua das dimensões dos transistores nos circuitos integrados tem provocado um aumento da vulnerabilidade de circuitos digitais à variações de tensão, temperatura e fabricação. Para reduzir esses impactos, tecnologias de fabricação como a Fully Depleted Silicon on Insulator e o paradigma assíncrono de concepção de circuitos digitais tem sido apontado como soluções robustas à essas variações. Neste estágio propõe-se o desenvolvimento de um fluxo de projeto de circuitos integrados assíncronos QDI em tecnologia FD-SOI. A concepção do leiaute de um microprocessador ARM7 simplificado síncrono foi proposta como tarefa inicial, objetivando-se uma melhor compreensão do problema e das ferramentas disponíveis para sua solução. Por fim, foram feitas simulações e síntese de circuitos half buffer duplo e somador completo assíncronos.pt_BR
dc.publisher.countryBrasilpt_BR
dc.publisher.departmentCentro de Engenharia Elétrica e Informática - CEEIpt_BR
dc.publisher.initialsUFCGpt_BR
dc.subject.cnpqEngenharia Elétrica.pt_BR
dc.titleProjeto de circuitos integrados assíncronos QDI em Tecnologia FD-SOI 28nm.pt_BR
dc.date.issued2015-08
dc.description.abstractThe downscale of semiconductors’ feature size has led to increases in vulnerability of digital circuitry to process, voltage and temperature variations. To reduce these impacts, manufacturing technologies such as FD-SOI and the asynchronous design approach have been pointed as robust solutions to this problem. This internship proposes an asynchronous QDI IC design flow using the FD-SOI technology. The design of the layout of a synchronous simplified ARM7 microprocessor has been proposed as an initial task aiming to better understand the problem and the tools available to solve it. At the end, simulations and logical synthesis of asynchronous QDI double half buffer circuit and full adder were performed.pt_BR
dc.identifier.urihttp://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/19849
dc.date.accessioned2021-07-05T20:42:08Z
dc.date.available2021-07-05
dc.date.available2021-07-05T20:42:08Z
dc.typeTrabalho de Conclusão de Cursopt_BR
dc.subjectEstágio em Engenharia Elétricapt_BR
dc.subjectEstágio na Françapt_BR
dc.subjectLaboratório de Técnicas de Informática e de Microeletrônica para Arquiteturas de Sistemas Integradospt_BR
dc.subjectGrenoble - INPpt_BR
dc.subjectCentre National de la Recherche Scientifiquept_BR
dc.subjectUniversité Joseph Fourierpt_BR
dc.subjectProjeto THINGS2DOpt_BR
dc.subjectTecnologia FD-SOIpt_BR
dc.subjectPolybiasingpt_BR
dc.subjectProjeto de circuitos integrados assíncronos QDIpt_BR
dc.subjectProcessador ARM7 simplificadopt_BR
dc.subjectCircuitos quase insensíveis ao atraso - QDIpt_BR
dc.subjectInternship in Electrical Engineeringpt_BR
dc.subjectInternship in Francept_BR
dc.subjectLaboratory of Informatics and Microelectronics Techniques for Integrated Systems Architecturespt_BR
dc.subjectTHINGS2DO Projectpt_BR
dc.subjectFD-SOI technologypt_BR
dc.subjectQDI asynchronous integrated circuit designpt_BR
dc.subjectSimplified ARM7 Processorpt_BR
dc.subjectNear delay-insensitive circuits - QDIpt_BR
dc.subjectStage en Génie Electriquept_BR
dc.subjectStage en Francept_BR
dc.subjectLaboratoire de Techniques Informatiques et Microélectroniques pour les Architectures de Systèmes Intégréspt_BR
dc.subjectTechnologie FD-SOIpt_BR
dc.subjectPolybiosept_BR
dc.subjectConception de circuits intégrés asynchrones QDIpt_BR
dc.subjectProcesseur ARM7 simplifiépt_BR
dc.subjectCircuits quasi insensibles au retard - QDIpt_BR
dc.rightsAcesso Abertopt_BR
dc.creatorLEITE, Thiago Ferreira de Paiva.
dc.publisherUniversidade Federal de Campina Grandept_BR
dc.languageporpt_BR
dc.title.alternativeDesign of QDI asynchronous integrated circuits in FD-SOI 28nm Technology.pt_BR
dc.identifier.citationLEITE, Thiago Ferreira de Paiva. Projeto de circuitos integrados assíncronos QDI em Tecnologia FD-SOI 28nm. 2015. 62f. (Relatório de Estágio Integrado) Curso de Bacharelado em Engenharia Elétrica, Centro de Engenharia Elétrica e Informática, Universidade Federal de Campina Grande - Paraíba - Brasil, 2015. Disponível em: http://dspace.sti.ufcg.edu.br:8080/jspui/handle/riufcg/19849pt_BR
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THIAGO FERREIRA DE PAIVA LEITE - RELATÓRIO DE ESTÁGIO ENG. ELÉTRICA 2015.pdfThiago Ferreira de Paiva Leite - Relatório de Estágio Eng. Elétrica 2015.1.62 MBAdobe PDFView/Open
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